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N32926U1DN

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Das N32926U1DN wurde speziell zur Beschleunigung der Video-/Audiostream-Leistung entwickelt, wenn H.264-Codec und MJPEG-Codec hauptsächlich für den Designaufbau im Videostream und die Hardware-AAC-Beschleunigung und der Soundprozessor für den dazugehörigen Audiostream in Cloud-Multimedia-Datenstromanwendungen verwendet werden. Die eingebetteten Video-Codec-Module und die schnellere Audio-Komprimierung/-Dekomprimierung verbessern die Leistung bei gleichzeitiger CPU-Entlastung zur Energieeinsparung.

Das N32926U1DN ist im ARM926EJ-S CPU-Kern eingebaut und im Video-Decoder (H.264), Ethernet-MAC, JPEG-Codec, der CMOS-Sensorschnittstelle, dem 32-Kanal-Soundprozessor (SPU), im ADC, DAC & TV-Encoder integriert, um unterschiedlichen Anwendungsbedarf zu decken und Stücklistenkosten einzusparen. Die Kombination aus ARM926 mit 240 MHz, DDR2, H.264-Codec und AAC-Beschleunigung, SDIO-Host-Controller & USB 2.0-Host/-Gerät macht das N32926U1DN zur optimalen Wahl für Video-/Audio-Streaming-Geräte.

Das N32926U1DN kann auch im Linux-Betriebssystem portiert werden, um sich die Treiberfähigkeiten von sich entwickelnden Funktionalitäten, z. B. Wi-Fi, Browser usw., zu Nutze zu machen. Andererseits bietet die Open Source-Code-Umgebung der Produktentwicklung auch mehr Flexibilität. Nuvotons kontinuierliche Optimierungen für Linux bieten Kunden eine kostengünstige Video-/Audiostream-Lösung. Zudem werden  USB- und SDIO Wi-Fi-Module von Drittanbietern eingeführt, um sie in Wi-Fi-Streaming-Anwendungen auf Geräten wie Smartphones, Tablets, Notebooks oder Smart-TV usw. optimal einzusetzen.

Die maximale Auflösung für das N32926U1DN beträgt D1 (720x480) am TV-Ausgang & 1024x768 auf einem TFT-LCD-Bildschirm. Bei wachsender Popularität von Videostream-Lösungen eignet sich H.264 am besten für Anwendungen mit eingeschränkter Bandbreite, die für hochauflösendes Video eine schnellere Datenrate benötigen. Das N32926U1DN ist in Bezug auf Kosten/Leistung für den Video-/Audio-Streaming-Markt gut aufgestellt, wo Wi-Fi, Ethernet oder firmeneigenes RF umfangreich eingesetzt wird. Für firmeneigene 2,4 GHz-Anwendungen entlasten der Hardware-CRC-Generator und Kontrollmodule die CPU, um Energie zu sparen. Zudem wird das Hardware-Kanal-Kodiermodul, wie Scrambler, Interleaver, Reed-Solomon-Außencodec- und Konvolutions-Innencodec-Module, für einen störungsfreieren Funk-Video-/Audio-Datenstrom in der gedrängten 2,4 GHz ISM-Bandumgebung eingesetzt.

Zur Minderung der Systemkomplexität und gleichzeitiger Einsparung von Stücklistenkosten wurde das N32926U1DN speziell mit dem 128-pol. LQFP-MCP (Multi-Chip-Modul) ausgestattet. Das 32Mbitx16 DDR2 befindet sich als Stack im MCP, um höhere Leistung zu gewährleisten und den Aufwand beim Systemdesign zu minimieren, wie z. B. elektromagnetische Störung & Rauschkopplung. Die gesamten Stücklistenkosten konnten durch Einsatz einer 2-lagigen Leiterplatte nebst Wegfall von Dämpfungswiderständen, Bauteilen zur Verhinderung von elektromagnetischer Störung & weniger Platz für die Leiterplatte gesenkt werden.

 

Datenblatt

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  • N3292x Data Sheet - A3 (web) 3.0  2014/03/05
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  •   Name Datum Online-Zertifikat
  • 2017新唐科技NuMicro微控制器新產品與應用研討會_基於Arm Mbed之物聯網全面解決方案&NuMicro創新方案 2017/12/01

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Part No. Check Disty Raw NAND I/F, ECC bits NAND Flash, No. of ECC bits CPU Max Speed I Cache D Cache SRAM Stacked SDRAM (bit) SPI Flash I/F SD / SDIO 1.1 Host (12 Mbps) USB 2.0 Host (480 Mbps) Device (FS / HS) 2D GFX JPEG Codec Video Codec RGB Color (bits) Max. Resolution SAR ADC 24-bit Σ-Δ ADC ADC for MIC Input Touch Panel (Wire) Stereo DAC (bits) JTAG Ethernet 10/100 MAC CMOS Sensor1 GPIO (Max) UART I2C SPI RTC PWM TV Output I2S Core Voltage (V) I/O Voltage (V) Package Status I/O I2S/ AC97 ADC Operating Temp. Range (°C ) SDRAM NOR Flash SPI Flash, No. of I/O Pins ATAPI USB 2.0 HS Device 2D Graphics TFT LCD Speed (Samples per second) Touch Screen Controller LVD/LVR External Bus Interface KPI PS2 PCI Master
N32926U1DN Check Disty 24   926 240 MHz 8K 8K 8K 32Mx16 DDR2 Y 3(two hardware host controllers) 1 1 HS   Y H.264 Codec MJPEG Codec 24 XGA(1024 x 768) Y(supports 12-bit SARADC)   Y(support optional channel for audio line-in) 4/5 16 Y Y Y(CCIR601 / CCIR656 I/F, 3M pixel) 80 2 1 2(Only one hardware SPI controller to support two SPI device with two chip selection signals) Y 4 Y Y 1.2 3.3 LQFP-128 (MCP) Mass Production                                    

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