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N32905U1DN

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N32905U1DNは、ARM926EJ-S CPUコア上に構築され、JPEGコーデック、CMOSセンサーインターフェイス、32 チャネルSPU(音声処理部)、ADCおよびDACと統合され、部品コストを節約しながら、様々な種類のアプリケーションニーズを満たしています。ARM926 @ 200MHz、シンクロナスDRAM、2D BitBLTアクセラレータ、CMOSイメージセンサインターフェイス、LCDパネルインターフェイス、USB 1.1 ホストおよびUSB2.0 HS デバイスの組み合わせにより、N32905U1DN は、LCD ELA機器用の最良の選択になります。

N32905U1DNの最大解像度は、TFT液晶パネルで、VGA(640x480)です。2D BitBLTアクセラレータは、グラフィック計算を加速し、消費電力を節約するために、レンダリングを滑らかに、CPU をオフロードします。

N32905U1DNは、Linux OSのアプリケーション用であり、Wi-Fi、ブラウザなどの新興機能のドライバを活用しています。一方、オープンソースコード環境により、製品開発をより柔軟に行うことができます。

システム全体の部品コストのさまざまな要件を満たすために、異なるサイズのDRAMが、N3290xメインSoC共に 1 つのパッケージに積層されています、つまり、マルチチップパッケージ(MCP)です。16Mbitx16 SDRAMが、より高い性能を確保し、EMIおよびノイズ結合などのシステム設計作業を最小にするために、N32905U1DNのMCP内部に積層されています。2 層PCBを採用し、ダンピング抵抗、EMI防止部品などを除去することで、総部品コストを低減することができました。その利点には、より少ないPCBス ペース、リードタイムの短縮、より信頼性の高い製造歩留まりなどがあります。

データシート

  • データシート

  • ファイル名 バージョン 更新 ダウンロード
  • N3290x Data Sheet revision A5.1 5.1  2014/03/05
  • 開発ツール

  • ファイル名 バージョン 更新 ダウンロード
  • NuMaker_NuWicam V1.0  2016/10/03
  • オンライントレーニング

  •   名称 日付 オンライン証明書
  • 2017新唐科技NuMicro微控制器新產品與應用研討會_基於Arm Mbed之物聯網全面解決方案&NuMicro創新方案 2017/12/01

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Part No. Check Disty Raw NAND I/F, ECC bits NAND Flash, No. of ECC bits CPU Max Speed I Cache D Cache SRAM Stacked SDRAM (bit) SPI Flash I/F SD / SDIO 1.1 Host (12 Mbps) USB 2.0 Host (480 Mbps) Device (FS / HS) 2D GFX JPEG Codec Video Codec RGB Color (bits) Max. Resolution SAR ADC 24-bit Σ-Δ ADC ADC for MIC Input Touch Panel (Wire) Stereo DAC (bits) JTAG Ethernet 10/100 MAC CMOS Sensor1 GPIO (Max) UART I2C SPI RTC PWM TV Output I2S Core Voltage (V) I/O Voltage (V) Package Status I/O I2S/ AC97 ADC Operating Temp. Range (°C ) SDRAM NOR Flash SPI Flash, No. of I/O Pins ATAPI USB 2.0 HS Device 2D Graphics TFT LCD Speed (Samples per second) Touch Screen Controller LVD/LVR External Bus Interface KPI PS2 PCI Master
N32905U1DN Check Disty None 15   926 200 MHz 8K 8K 8K 16Mx16 DDR Y 3(one hardware host controller) 1   HS   Y MJPEG Codec(Motion JPEG Codec, VGA 30fps) 18 VGA(640x480) Y   Y 4 16 Y   Y(CCIR601 / CCIR656 I/F, 2M pixel) 64 2 Y 2(Only one hardware SPI controller to support two SPI device with two chip selection signals) Y 4   Y 1.8 3.3 LQFP-128 (MCP) Mass Production                                    

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